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单端缓冲器
使用我们易用型单端缓冲器优化您的设计并生成多个 lvcmos 时钟源。
差分缓冲器
使用我们的差分缓冲器为 lvds、lvpecl、hcsl 和 cml 生成多个输出频率。
可配置缓冲器
使用我们的可配置（引脚可编程）时钟缓冲器为一系列协议生成多个输出频率。
专用缓冲器
利用我们具有更低附加抖动的专用缓冲器产品系列优化工业和存储器应用中的系统设计，包括零延迟缓冲器、ddr 内存缓冲器和分频缓冲器。
技术资源
应用手册
how to apply 1.8-v signals to 3.3-v cdclvc11xx fanout clock buffer
了解 cdclvc11xx 系列低抖动 lvcmos 扇出缓冲器如何通过实施外部 rc 网络支持电压电平高达 1.8v 的输入信号。
应用手册
ac coupling between differential lvpecl, lvds, hstl and cml (rev. c)
请参阅此应用报告，了解用于在不同逻辑电平之间进行连接的交流耦合技术，尤其是 lvpecl、lvds、hstl 和 cml。
应用手册
clocking design guidelines: unused pins
这些指南可作为器件数据表的补充，提供有关未使用器件引脚的详细信息。